論理設計実習 第1回 実習の目的

論理設計実習
第1回
「今、組込みシステムが熱い!」
井口幸洋
http://www.iguchi-meiji.com
資料協力:笹尾勤教授(九州工業大)
2015/10/1
論理設計実習
1
日本の産業は何を売って外貨を稼ぐか?
• OS: Microsoft Windows, Linux, Solaris 日本の出る幕なし
• アプリケーションソフト: 世界標準 日本が切り込むのは困難
• ゲーム 2004年は2327億円の輸出超過産業
– 日米欧ゲーム産業ソフトとオンラインゲームの売上高2兆4000億円 (映
画の興行収入は1兆8000億円,CDの売上高2兆8000億円)
• 白物家電(洗濯機、冷蔵庫、掃除機)の衰退
• 軍事産業 ×
• 携帯電話
– ノキア、モトローラ、サムスン 日本企業の名前は出てこない
– 日本国内では元気
• 自動車,オートバイ
• 液晶テレビ
組み込みシステムが日本
の産業の生きる道
– 1位Philips, 2位Samsung, 3位Sharp, 4位Sony, 5位LGE (台数)
• HDD/DVD録画機 Panasonic, 東芝,パイオニア
• 素材産業
2015/10/1
論理設計実習
2
目次
• 組込みシステム
• LSI (Large Scale Integrated Circuits)の進歩
– LSI製造の問題点
• ソフトウェアとハードウェア
• 書き換え可能な柔らかいハードウェア
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論理設計実習
3
組み込みシステム
• エンベデッド・システム (Embedded System).
• 特定の機能を実現する目的でコンピュータを組
み込んだ特定目的のシステム.
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論理設計実習
4
自動車という組み込みシステム
• 自動車には20~50個程度のマイクロプロセッ
サ(MPU)が搭載されている
• エンジンの燃料噴射、ブレーキの制御(4輪独
立制御)、サスペンションの制御、衝突回避、
カーナビゲーションシステム、パワーウィンドウ、
etc.
• 自動車の約1/3 がエレクトロニクス部品のコスト
(ハイブリッド車では1/2 )
• レクサスの最高級車は100個以上のMPUを搭
載
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論理設計実習
5
組み込みシステム技術者の不足
• 組込みシステム = ハードウェア + ソフトウェア
– ハードウェアを知っているソフトウェア技術者の不足
– ソフトウェアを知っているハードウェア技術者の不足
• ソフトウェア部分の負荷が非常に重たい
– 人材不足
– 開発期間の短さ
– 開発コード量の増大・複雑化
• ITエンジニア 730,000人
– 組込みソフトウェア人口は1/4 の 175,000人
– まだ,70,000人が不足 売り手市場!
• ハードウェア設計
– 大規模・複雑化・短TAT (Turn Around Time)
– ソフトウェアとの協調設計の難しさ
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論理設計実習
6
目次
• 組込みシステム
• ソフトウェアとハードウェア
• LSI (Large Scale Integrated Circuits)の進歩
– LSI製造の問題点
• 書き換え可能な柔らかいハードウェア
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論理設計実習
7
HWとSWの境界の変化
境界が固定
ハードウェア
(CPUなど)
ソフトウェア
現在のコンピュータ
ハードウェア ハードウェア
(CPUなど) (ASIC)
ソフトウェア
アプリケーションに合わせて
境界が変更される
リコンフィギャラブル・ ハードウェア やわらかいハードウェア
ソフトウェア
コンピュータ (CPUなど)
(FPGA/PLD)
(HWの高性能と
FPGA:Field Programmable Gate Array
SWの柔軟性を
PLD :Programmable Logic Device
合わせ持つ)
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論理設計実習
8
目次
• 組込みシステム
• ソフトウェアとハードウェア
• LSI (Large Scale Integrated Circuits)の進歩
– LSI製造の問題点
• 書き換え可能な柔らかいハードウェア
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9
VLSIとは?
• Very Large Scale
Integrationの略
• 超大規模集積回路
• 数十万~数千万個のトラ
ンジスタがワンチップに集
積されたもの.現在,トラ
ンジスタ数は,一億個を越
えているものもある.
Intel P4 のチップ写真
• Pentium 4: 125 – 169
million transistors.
http://www.intel80386.com/
2015/10/1
論理設計実習
10
nMOSトランジスタの構造
ゲート
ソース
n+
チャネル
Metal 金属(ゲート)
Oxide 酸化膜(絶縁膜)
Semiconductor 半導体
ドレイン
n+
L
p形半導体基板
W
①ゲートソース間電圧による
電圧制御形素子
②ゲート電流が流れない
③しきい電圧の存在
2015/10/1
論理設計実習
11
MOSトランジスタ
D
・正式には、
MOS電界効果トランジスタ
回路記号
(Metal-Oxide-Semiconductor Field
Effect Transistor;MOSFET)。
S
G
G
S
nMOS
D
pMOS
・MOSのS(ソース)とD(ドレイン)は、
対称な構造をしており、
物理的には、どちらでもよい。
電流の方向で、SとDを決める。
矢印が電流の向きを表す。
・電流の流れる方向
nMOS:D→S、pMOS:S→D
回路図を書く場合、上部から下部に
向かって電流が流れるように書く。
(nMOS、pMOSのDとSの位置に注意)
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論理設計実習
12
動作原理
Off (VG <VT ) 金属
D
G
S
n+
n+
ゲートと基板の間にバイアス電圧を
掛けると、ある電圧を越えた時に、
ゲート下の酸化膜の下に電子が集まり、
チャネルという電子の通り道ができる
p形基板
空乏層
S
On (VG >VT ) 酸化膜
G
D
n+
このとき、ドレイン-ソース間に
バイアス電圧をかけると、チャネルを
通して電流が流れるようになる
n+
チャネル
この境界となるゲート電圧を
しきい電圧といい、VT と表わす
電子の流れ(電流は逆向き)
2015/10/1
論理設計実習
13
スケーリング則
VG/k
VG
tox/k
tox
xj
n+
NA
L
n+
MOSトランジスタは
寸法を縮小すると
性能が向上
n+
n+
xj/k
L/k
kNA
p基板
p基板
等電界縮小則
スケールする
物理量
ゲート長
L
ゲート幅
W
ゲート酸化膜 tox
接合深さ
xj
電圧
VD ,VG
不純物濃度 NA,NSUB
縮小 左記のスケールにより 縮小
率 変化する回路パラメータ 率
1/k 電流密度
I
1/k
1/k 容量
C
k
1/k 遅延時間/回路 VC/I 1/k
1/k 消費電力/回路 VI
1/k2
1/k 消費電力密度 VI/A
1
k
単位面積あたりの消費電力は
集積できる素子数がk2倍に
なるので、変わらない
↑寸法、電圧とも1/k倍しているので、内部電界は一定
2015/10/1
論理設計実習
14
プロセス技術の進歩
出典1999 ITRS
半導体市場はこの半導体技術ロードマップより前倒しで進行している
2015/10/1
論理設計実習
15
International Technology Roadmap for Semiconductors 2002
(μm)
Process Technology
3.0
(Trs)
Process
5.0
4G
3.0
2.0
1.0
1G
1.3
16G
1G
256M
64M
0.8
0.5
64G
65nm = 650 A
0.5
0.35
Memory 16M 0.25
0.18
0.09
4M
0.13
0.065
1M
0.045
256K
0.032
0.2
0.1
0.05
64K
1M
ムーアの法則
「半導体の集積度は1.5年で2倍になる」
0.02
1980
2015/10/1
1990
2000
論理設計実習
2010
(Year)
16
Mooreの法則
• 半導体の集積度は指数
関数的に増える.
• 18ヶ月で2倍.
• トランジスタ1個あたりの
値段は、指数関数的に
下がる.
Intel社の創立者の一人: Gordon E. Moore
2015/10/1
論理設計実習
17
マスクとウェハ
・LSI設計結果の図形データは、プロセス工程ごとに、
5倍 or 10倍の大きさで20~30枚のマスクに転写される。
・マスクの図形データは、1/5 or 1/10の縮小投影露光で
配列チップ数回、ウェハ上に繰返し描画される。
5inch角マスク
300mm直径ウェハ
(フォトマスク、レチクルともいう)
(写真は拡散工程まで進んだ状態)
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18
シリコン・ウェハー・インゴット
• 信越化学工業:供給世界1位
• SUMCO(旧三菱住友シリコン):世界2位
• MEMC(米国):世界3位
金属ケイ素から作られた
99.999999999%の
高純度のケイ素の塊、多結晶
シリコン (信越化学工業の
Webより抜粋)
2015/10/1
論理設計実習
19
レチクル(フォトマスク)
• 凸版印刷,大日本印刷,
デュポン.
• 1セットで約1億円.
• Link: m・FSI株式会社の採用情報,半導体が
できるまで http://www.mfsi.co.jp/ より図を利
用しました.Webを参照するとよくわかります.
2015/10/1
論理設計実習
20
LSIの歩留りとコスト
売上個数
1兆個
チップ価格と製品数
1000億個
総売り上げ1,000億円の場合
●
●
●
●
中国 13億人
1個0.1円で1兆個
RFID chip
1個1,000円で1億個(部品の世界)
メモリ、MCU
10億個
米国 2.9億人
1億個
日本 1.3億人
1000万個
100万個
1個1万円で1,000万個(普及型製品)
高性能プロセッサ、ゲーム、
携帯電話
10万個
1万個
1個1億円で1,000個(先端技術分野) 1000個 0.1円
宇宙搭載用、軍用、重要な社会基盤
2015/10/1
世界人口61億人
100億個
論理設計実習
10円
1000円 1万円
100万円
1億円
販売単価
21
LSI工場の建設コスト
•
•
•
•
•
•
45nmデザインルール
ウエハーサイズ300mm
論理系
一ヶ月3万枚
毎年1200億円(3年で3600億円)の投資
半導体の売り上げ高が1.2兆円以上必要
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論理設計実習
22
プレイステーション2用CPU
•
•
•
•
1999年3月4日発表
大分工場:東芝とソニーの合弁で建設
「Emotion Engine」の製造。
0.18ミクロン半導体製造技術
• ソニー長崎の工場内に建設
• 「グラフィック・シンセサイザ」の製造。
• 2560ビット幅内部バスを実現するDRAM混載技術
• 二つの工場に総額1200億円投入
• 2005年までに世界で累計1億台出荷
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論理設計実習
23
歩留り:Y=exp(-A・D)
A:チップ面積(cm2)、D:欠陥密度(ヶ/cm2)
100
A:チップ面積
5mm□
7mm□
10mm□
14mm□
20mm□
90
80
歩 70
留 60
り 50
(%)
40
30
歩留り向上
↑
チップ面積縮小
20
↑
10
集積度向上
0
0.001
2015/10/1
0.01
0.1
1
D:欠陥密度 (ヶ/cm2)
論理設計実習
10
100
24
試算例:チップ面積縮小化の効果
64Mb DRAM
チップ面積
18.4mm
17.9mm
×8.8mm
×8.6mm
=161.9mm2
=153.9mm2 ( -5%)
歩留り
80%
81% ( +1%)
チップ数/ウェハ
52個
58個
良品チップ数
42個
46個 (+12%)
チップ辺長をわずか0.5、0.2mm縮めるだけで、収益が12%増える!!
2015/10/1
論理設計実習
25
良品チップ数/ 5inchウェハ
D=0(配列チップ数)
D=0.2
D:欠陥密度(ヶ/cm2)
D=0.4
D=0.6
D=0.8
D=1.0
1000
401
312
良
品 100
チ
ッ
プ
10
数
(ヶ)
168
87
55
95
34
24
21
13
8
5
32
11
3
1
0
5
10
15
18
12
13
7
7
3
2
3
1
1
9
4
2
20
チップサイズ(mm□)
1
25
30
チップ面積が大きくなると、
歩留り低下→ウェハ当りの良品チップ数減少→チップ単価上昇
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論理設計実習
26
ウェハサイズ・チップ面積・配列チップ数
5 inch ウェハ
ウェハサイズ大口径化
8 inch ウェハ
(直径200mm)
×
×
×
×
×
×
20mm□チップ
20mm□チップ
配列チップ数 18
良品チップ数 12
歩留り 67%
配列チップ数 61
If 歩留り 67%
良品チップ数 40
チップ面積縮小化
×
×
19mm□チップ
×
×
×
×
2015/10/1
配列チップ数 24
良品チップ数 19
歩留り 79%
論理設計実習
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配列チップ数/ウェハ
10000
8inchウェハ
5inchウェハ
1177
配 1000
列
チ
ッ 100
プ
数
(ヶ) 10
506
275
168
401
112
168
83
61
87
44
34
55
34
24
18
12
9
1
0
5
10
15
20
25
30
チップサイズ(mm□)
ウェハ径を大きくすれば、ウェハ当りの配列チップ数増加
2015/10/1
論理設計実習
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論理LSIおよびメモリLSIのトランジスタ、ビット当りの価格推移
論理(トランジスタ/cm2) 4M
メモリ(ビット/チップ)
64M
7M
256M
ミリセント/ビット(メモリ)
ミリセント/トランジスタ(論理)
100
13M
1G
25M
4G
50M
16G
90M
64G
論理LSI
(マイクロプロセッサ)
10-1
10-2
メモリLSI
(DRAM/フラッシユ)
10-3
10-4
1995
2000
2005
2010
年
集積度向上→ 1素子当りのコスト低減
2015/10/1
論理設計実習
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試算例:チップ生産個数とチップ原価の相関
LSI コスト総和=D+m+P+p
D :設計コスト(人件費+設計設備投資) ∝ 設計生産性
m :マスク作成費 ∝ マスク枚数
P :製造コスト(ライン費+テスト費) ∝ 製造ウェハ枚数
p :パッケージコスト ∝ 良品チップ数=チップ生産個数 N
[試算での仮定]
チップ原価=(D’÷N)+p’
D’ =100M\ =D+m ・・・・・・・ 設計コスト(マスク作成費を含む)
p’ = 2 K\ =(P+p)÷N ・・・ 1チップ当りの製造コスト(パッケージを含む)
チップ生産個数
チップ原価(K\)
設計コスト
製造コスト
1K
10K 100K
102
12
3
100
10
1
2
2
2
1M
10M
2.1
2.01
0.1
0.01
2
2
1K
10K 100K
-90
0
900
-99
-90
0
-99.9
-99
-90
1M
10M
9,900 99,900
900 9,900
0
900
売上利益(M\)
チップ生産個数
12
3
チップ売価
(K\)
2.1
2015/10/1
論理設計実習
30
LSIでもうけるには
• 大量に生産し、大量に売れること
– 世界中の人が使ってくれる
– MPU(マイクロプロセッサ)
– メモリ
• 少量でも高く買ってもらえるアプリケーションが
ある
• 歩留まり(Yield)を上げる
2015/10/1
論理設計実習
31
目次
• 組込みシステム
• ソフトウェアとハードウェア
• LSI (Large Scale Integrated Circuits)の進歩
– LSI製造の問題点
• 書き換え可能な柔らかいハードウェア
2015/10/1
論理設計実習
32
米Intel、ICH6の不具合を確認
一部を回収・交換
MYCOMジャーナル 2004/6/26 Yoichi Yamashita より抜粋
• Intelが6月21日にリリースした最新チップセット「Intel
925X」「Intel 915G/P」に搭載されている「ICH6」に不
具合が確認された。起動時にBIOSの設定がデフォル
トにリセットされ、「起動できない」「システムがフリーズ
する/特異な振る舞いを起こす」などの症状が確認され
ている。
• 現在、Intelは被害の範囲を確認する作業を進めながら、
不具合のある製品の回収・交換に努めている。現時点
では、不具合は極めて早い段階にOEMやマザーボー
ドベンダーに出荷したロットのみで確認されている。
2015/10/1
論理設計実習
33
ascii24.com より抜粋
2015/10/1
論理設計実習
34
システムのバグは無くすことは不可能?
• ソフトウェアのバグ
– Microsoft Windows では山ほどバグがある
– 組込みシステムのバグは,致命的な場合がある
•
•
•
•
社会的信用
PL法.訴訟の対象にもなる.
回収費用・修正の費用
オンラインでバグフィックス
• ハードウェアのバグ
– LSIチップを作り直すと 1億円以上の費用発生の可能性
– 他社との競争に負けて撤退なんてことも
– バグではないが,仕様変更に柔軟に対応する必要あり!
• なんとかしないとだめだ!
→ そうだ書き換えできるハードウェアだ!
2015/10/1
論理設計実習
35
FPGA : Field Programmable Gate Array
・ユーザの手許でカスタム化(プログラム)可能なLSI
・カスタム化のためのLSIの試作期間や開発費が不要
論理
ブロック
論理
ブロック
論理
ブロック
論理
ブロック
論理
ブロック
論理
ブロック
論理
ブロック
論理
ブロック
論理
ブロック
小規模論理ブロックを規則的に配置し、
その周囲にはプログラム可能な配線を
配置したもの
・論理ブロックの形式には、
ルックアップテーブル、マルチプレクサ、
ゲートアレイなどのタイプがある。
・配線の交差点には、
SRAM、EEPROM、アンチヒューズ等
を利用したプログラム用デバイス(スイッチ)
が組込まれている。
SRAM:Static Random Access Memory
EEPROM:Electrical Erasable and Programmable
Read Only Memory
2015/10/1
スイッチ
論理設計実習
36
次回につづく
• 次回予告
– 「FPGA」とは何か?
– Verilog-HDL入門
• http://www.iguchi-meiji.com/
– Logic Design Lab.をクリックし、そこに書いてあること
を読み、 開発システムをインストールしてみてください
– パスワード:
– ポップアップブロッカーなどをいれている場合は、それ
を一時停止するか回避してください.Google検索をつ
かっている場合はctrlキーを押しながらOKを押します.
2015/10/1
論理設計実習
37